bus

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    VHDL中的微控制器的总线协议

    我正在设计一个VHDL中的微控制器。我理解每个组件（ALU/Memory ...）的作用，以及如何实现它们的一些想法。我基本上想要实现冯诺依曼体系结构。 但这里是我没有得到：组件如何沟通？我不知道如何设计我的巴士（巴士？）。因此，我正在寻找一个简单的总线实现和协议。 我的悬而未决的问题： 它是简单的有一个公共汽车一切或分离不同类型的数据？ 每个组件如何知道何时“听”以及何时“写”？ 重点是设计的简
    vhdl microcontroller fpga bus 2013-10-12

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    在VHDL中驱动与SRAM共享的GPIO引脚

    我已经从Micronova购买了一块Spartan 3A开发板（http://micro-nova.com/mercury），并且我的接口与SRAM有一些问题。 该电路板有30个GPIO引脚与Cypress SRAM共享，两个引脚在它们之间切换。 明显地，将两个VHDL模块（一个用于控制SRAM，另一个用于驱动GPIO）连接到同一引脚会导致合成时出现“Multiple driver error”。
    vhdl bus spartan 2013-09-01

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    get_pixel函数引发总线错误：10

    #include <sys/types.h> #include <sys/stat.h> #include <sys/mman.h> #include <fcntl.h> #include <stdio.h> #include <stdlib.h> #include <string.h> #include <unistd.h>
    c macos bus 2013-12-10

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    使用字符串数组时总线错误10 - C

    我有一个程序在选项参数（-r，-d等）后面带有非选项参数（来自命令行）并插入每个非选项参数成阵列。可以键入的非选项参数的最大数量是25. 但问题是，当我运行程序时出现'Bus Error 10'错误，我不知道为什么。看着有类似问题的很多帖子，但似乎无法修复矿山 的代码是： void loop_namelist(int argc, char *argv[]) { int index = 0;
    c arrays string bus 2013-10-24

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    Websphere Message Broker和Websphere Transformation Extender的安装

    我遇到了在Windows环境中使WMB和WTX一起工作的问题。所有的安装似乎已经成功安装。 现在，当我加入的消息流的WTX节点，我得到2个例外： 显示java.lang.NullPointerException在com.ibm.websphere.dtx.WTXPlugIn.BrowseLocalCompiledMap.checkCompiledMap（来源不明） java.lang.NoClas
    messaging messagebroker bus broker 2013-10-25

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    并行ATA（PATA）也称为串行总线？

    并行ATA（PATA）也称为串行总线？如果是，那么串行ATA（SATA）也称为串行总线？
    hardware bus 2013-12-14

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    如何在多个驱动程序中处理Verilog中的总线

    我试图在Verilog中连接多个模块，共享一个大小为16位的常见“总线”。我在将多个输入（驱动程序）连接到BUS时遇到问题。当我连接多个驱动程序时，我在Xilinx中遇到错误。 信号总线在单元{Top_Module_Name}被连接到下面的多个驱动程序： 我的代码模块是 input en; output [15:0] BUS; reg [15:0] data; if (en) begi
    verilog processor xilinx bus 2013-12-15

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    总线故障的软件内存测试

    我有一块有很多闪存芯片的电路板，其中一些显示出间歇性故障。标准内存测试没有显示任何特定的问题地址，除了某些芯片在机械和热应力下间歇性故障。 怀疑实际的连接，而不是闪存单元本身，我正在寻找一种方法来测试并行总线的地址或数据引脚错误。 有一些内存测试，但它们更适用于RAM而不是闪存（http://www.ganssle.com/testingram.htm）。具体而言，并行闪存具有写入每个值的总线写入
    testing embedded bus flash-memory industrial 2013-12-17

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    MESI协议 - 如何处理INVALID？

    我想实现一个示例MESI缓存模拟器有两个级别的缓存（写回）。我已将MESI状态位添加到两级缓存。由于它是写回缓存，所以只有在刷新刷新时，缓存行才会更新为L2。我的疑惑是 当从L1缓存刷新具有INVALID状态的缓存行时应该如何行为。它会忽略交易吗？看来这是唯一的可能性..但它看起来不正确。 考虑处理器1（P1）修改由处理器2（P2）共享的缓存线。然后，P2中的该缓存行将获得状态INVALID。如果
    java multithreading caching processor bus 2013-12-17

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    Poulsbo系统控制器集线器（US15W）中用于LPC总线的配置寄存器

    我们有一个基于Atom Z510/Intel SCH US15W Q7卡（运行Debian Linux）的系统。我们需要在Low引脚数量总线。据我所知，这款芯片组不提供DMA设备，这意味着处理器必须在软件循环中一次读取一个字节的数据。 （设备驱动程序这个使用“代表锑化铟” x86指令，因此该循环由，如果我理解正确的CPU实际执行的实际实现。） 这是远远没有达到最佳，但它应该是可以打一个传输速率14
    embedded hardware linux-device-driver embedded-linux bus 2013-09-28
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